GD32F405RET6MCU 兆易创新 GD32F101ZIT6

8位MCU工作频率在16~50MHz之间，强调简单效能、低成本应用，在目前MCU市场总值仍有一定地位，而不少MCU业者也持续为8bit MCU开发频率调节的节能设计，以因应绿色时代的产品开发需求。
16位MCU，则以16位运算、16/24位寻址能力及频率在24~100MHz为主流规格，部分16bit MCU额外提供32位加/减/乘/除的指令。由于32bit MCU出现并持续降价及8bit MCU简单耐用又便宜的低价优势下，夹在中间的16bit MCU市场不断被挤压，成为出货比例中的产品。
32位MCU可说是MCU市场主流，单颗报价在1.5~4美元之间，工作频率大多在100~350MHz之间，执行效能更佳，应用类型也相当多元。但32位MCU会因为操作数与内存长度的增加，相同功能的程序代码长度较8/16bit MCU增加30~40%，这导致内嵌OTP/FlashROM内存容量不能太小，而芯片对外脚位数量暴增，进一步局限32bit MCU的成本缩减能力。

2. 存储器结构
传统上，GPP使用冯.诺依曼存储器结构。这种结构中，只有一个存储器空间通过一组总线（一个地址总线和一个数据总线）连接到处理器核。通常，做一次乘发生4次存储器访问，用掉至少四个指令周期。
大多数DSP采用了哈佛结构，将存储器空间划分成两个，分别存储程序和数据。它们有两组总线连接到处理器核，允许同时对它们进行访问。这种安排将处理器存储器的带宽加倍，更重要的是同时为处理器核提供数据与指令。在这种布局下，DSP得以实现单周期的MAC指令。
典型的高性能GPP实际上已包含两个片内高速缓存，一个是数据，一个是指令，它们直接连接到处理器核，以加快运行时的访问速度。从物理上说，这种片内的双存储器和总线的结构几乎与哈佛结构的一样了。然而从逻辑上说，两者还是有重要的区别。
GPP使用控制逻辑来决定哪些数据和指令字存储在片内的高速缓存里，其程序员并不加以（也可能根本不知道）。与此相反，DSP使用多个片内 存储器和多组总线来保证每个指令周期内存储器的多次访问。在使用DSP时，程序员要明确地控制哪些数据和指令要存储在片内存储器中。程序员在写程序时，必 须保证处理器能够有效地使用其双总线。
此外，DSP处理器几乎都不具备数据高速缓存。这是因为DSP的典型数据是数据流。也就是说，DSP处理器对每个数据样本做计算后，就丢弃了，几乎不再重复使用。

1.对密集的乘法运算的支持
GPP不是设计来做密集乘法任务的，即使是一些现代的GPP，也要求多个指令周期来做一次乘法。而DSP处理器使用的硬件来实现单周期乘 法。DSP处理器还增加了累加器寄存器来处理多个乘积的和。累加器寄存器通常比其他寄存器宽，增加称为结果bits的额外bits来避免溢出。同时，为了 充分体现的乘法-累加硬件的好处，几乎所有的DSP的指令集都包含有显式的MAC指令。

大多数DSP使用定点计算，而不是使用浮点。虽然DSP的应用必须十分注意数字的，用浮点来做应该容易的多，但是对DSP来说，廉价也是非 常重要的。定点机器比起相应的浮点机器来要便宜（而且更快）。为了不使用浮点机器而又保证数字的准确，DSP处理器在指令集和硬件方面都支持饱和计算、舍 入和移位。

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