支持热插拔可配置上拉/下拉模式片内100欧姆差分电阻可配置施密特触发器,0.5V迟滞兼容5V输入优化MIPI HS/LP IO支持时钟资源? 16路全局时钟? 针对高速I/O接口设计的2路IOCLK ? 优化全局时钟的2路快速时钟? PLLs用于频率综合- 7路时钟输出- 分频系数1到128- 支持5路时钟输出级联 - 动态相位选择配置模式? 主模式串行SPI (MSPI)? 从模式串行 (SS)? 从模式并行x8 (SP)? 主模式并行x8 (MP)? JTAG模式 (IEEE-1532)BSCAN? 兼容IEEE-1149.1增强安全设计保护? 每个芯片拥有的64位DNA? 位流支持AES加密嵌入式硬核IPADC? 8比特逐次逼近寄存器型(SAR)? 8个模拟输入 ? 1MHz采样速率(MSPS)? 内置环形振荡器丰富封装形式? 标准尺寸:TQFP/BGA? 小尺寸: XWFN42配置模式· MSPI模式· 从模式串行 (SS)· 从模式并行x8 (SP)· 主模式并行x8 (MP)· JTAG模式 (IEEE-1532)增强安全设计保护· 每个芯片拥有的64位DNA· 支持位流AES加密嵌入式硬核IP· 内置环形振荡器丰富封装形式· caBGA332· caBGA400定位通信、工业控制和服务器市场,多支持336个 I/O,满足客户板级IO扩展应用需求。EF3器件采用先进的55nm低功耗工艺,优化功耗与性能,并可以通过低成本实现较高的功能。器件旨在用于大批量、成本敏感的应用,使系统设计师在降低成本的同时又能够满足不断增长的带宽要求。时钟资源· 16路全局时钟· 针对高速I/O接口设计的2路IOCLK· 优化全局时钟的2路快速时钟· 多功能PLLs用于频率综合· 支持7路时钟输出· 分频系数1到128· 支持5路时钟输出级联· 动态相位调节
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